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3D堆叠不会烧!华为韬定律用实测数据反驳3D堆叠发热论
📋总体概括
华为半导体业务部总裁何庭波在中科院预发布平台ChinaXiv发表论文,以麒麟2026量产芯片实测数据反驳3D堆叠必然发热的行业质疑。该芯片采用逻辑折叠技术,晶体管密度从1.55亿/mm²提升至2.38亿/mm²,增幅55%,相当于过去三年传统工艺微缩的成果;同等性能下NPU功耗降66%、GPU降58%、CPU性能核心降41%。其核心逻辑是:芯片能耗大头在金属走线传输而非晶体管计算,垂直堆叠以极短垂直互连替代长距离水平走线,核心连线缩短约20%、关键路径最多缩短70%,走线缩短降低互连电容,可进一步下调电压,动态功耗与电压平方成正比,故功率密度反降73%(NPU在29 TOPS下频率降63%、电
⚡关键信息
- ▸何庭波在ChinaXiv发表论文,用麒麟2026量产芯片实测数据反驳3D堆叠发热论
- ▸逻辑折叠使晶体管密度从1.55亿/mm²升至2.38亿/mm²,增幅55%,相当于三年传统微缩成果
- ▸同等性能下NPU、GPU、CPU性能核心功耗分别下降66%、58%、41%
- ▸NPU保持29 TOPS时频率降63%,电压从0.85V降至0.55V,功率密度暴跌73%
- ▸芯片能耗大头在金属走线传输;逻辑折叠使核心连线缩短约20%,关键路径最多缩短70%
🔥犀利点评
这篇论文本质上是在重写功耗公式的前提——过去大家默认堆叠等于热量叠加,华为用数据指出真正的功耗大头是走线而非晶体管,把垂直互连变成降压降频的杠杆。这确实击中了后摩尔时代的关键痛点:先进制程越来越贵,3D堆叠本是被逼出来的出路,却被热问题卡了脖子。但要保持清醒:量产芯片实测比论文演示更有说服力,散热、良率、成本这些工程账才是3D堆叠能否规模化的真正考题,一篇论文推翻不了所有质疑。
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