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半导体的胜负手,早就不在纳米上了

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📋 总体概括

当制程微缩越来越贵、越来越难,产业竞争的主战场正在转移:封装从配角变主角,IP层以94.5亿美元规模卡住全行业咽喉,存储领域的暗战则敲响了知识产权与地缘的双重警钟。三条线索拼出的,是半导体下半场的真实竞争图谱。

📄 正文

半导体的胜负手,早就不在纳米上了

过去十年,我们讨论芯片竞争力,几乎默认只有一个坐标系:制程节点。5纳米、3纳米、2纳米,像接力棒一样被 TSMC、英特尔、三星 轮番传递。

但最近围绕先进封装、设计IP和存储产业的三组信息,指向同一个判断:决定芯片胜负手的,正在从晶体管层面,向上迁移到封装与IP层,向外扩散到知识产权与地缘规则层面。

摩尔定律没有死,但它不再是唯一的剧本。这篇文章把三条线索摆在一起,看看半导体下半场到底在打什么仗。

📦 先进封装:从后道工序到前排主戏

尺寸不缩了,那就把芯片拆开拼。

SemiWiki 近期专门撰文对比了 TSMC、英特尔代工 和 三星代工 的先进封装路线,这个动作本身就是信号——封装第一次被放到了和制程平起平坐的对比维度上。

逻辑不复杂:当传统晶体管微缩越来越困难、成本越来越离谱,继续把一颗处理器做成一整块大芯片(monolithic die)的性价比正在崩塌。行业给出的解法是 Chiplet(芯粒):把处理器拆成更小的裸片,把逻辑、存储、输入输出等不同功能模块分别用各自最合适的工艺制造,再在封装环节拼回一体。

用一句话概括产业逻辑的变化:过去是“一颗芯片决定性能”,现在是“一套系统决定性能”。

三家的路线并不相同,据 SemiWiki 对比整理的公开数据:

厂商代表平台关键指标
TSMCCoWoS / InFO / SoIC2.5D CoWoS 是当前AI芯片绝对主力,硅中介层面积持续扩大,Blackwell 级别产品需多枚 reticle 拼接;3D堆叠路线 SoIC 的微凸点间距约 6μm,处于行业最前列;CoWoS 产能 2024 年同比翻倍以上,2025 年继续大幅扩产
英特尔代工Foveros / EMIBEMIB 桥接无需整片中介层,成本结构更优;Foveros Direct 采用直接混合键合,凸点间距向 9μm 以内推进,英特尔宣称互连密度行业最高;自用经验积累最久,3D键合量产记录最长
三星代工I-Cube / H-Cube / 3D IC2.5D 路线技术版图完整,但在AI芯片封装订单与生态成熟度上明显落后于前两家,处于追赶位置

这带来两个深远影响:

第一,制造环节的价值权重下移。先进封装成为提升算力的关键路径,封装厂、基板厂、键合设备商的议价能力全面上升。这种紧张已经不是内部消息——英伟达 CEO 黄仁勋等大客户高层多次公开表示,先进封装产能是他们获取算力的最大瓶颈之一,封装排期的紧张程度已不亚于最先进的晶圆产能。这在五年前是不可想象的。

第二,三家代工厂的竞争维度被拉宽了。TSMC、英特尔、三星在先进封装上的路线对比,意味着客户选择代工厂时,不再只问“你的晶体管多密”,还要问“你的异构集成能力多强、Chiplet生态多开放”。制程领先半代的优势,可能被封装方案的成熟度部分对冲——6μm 与 9μm 的凸点间距差距,正在成为新的“半代”刻度。

换句话说,先进封装正在把“制造之争”改写成“系统集成之争”。谁能在封装环节把逻辑、存储、IO拼得更快、更便宜、更可靠,谁就在AI算力时代握住了真正的产能咽喉。

🧩 IP层:94.5亿美元卡住万亿产业的脖子

最贵的不是最大的那块,而是绕不过去的那块。

SemiWiki 的另一篇分析给出了一个反直觉的数字:全球半导体设计IP市场规模只有 94.5亿美元(约95亿美元)——放在一个加速冲向万亿美元规模的半导体产业里,这个数字小得像个体量错觉。

但它被定义为整个全球半导体价值链的“绝对架构瓶颈”(architectural bottleneck)。原因在于:IP层今天做出的选择,会直接决定下游技术经济的成本、功耗和安全。你选了谁的指令集、谁的接口IP,你的芯片从设计第一天起,命运就被部分锁定了。

维度IP层的角色
市场规模约94.5亿美元
产业位置全价值链的架构咽喉
决定内容下游的成本、功耗、安全
当前格局Arm垄断与RISC-V回应并存

这个格局里有两个变量值得关注:

一是 Arm 的垄断地位。Arm 架构在移动和嵌入式领域的事实标准地位,意味着几乎每一颗智能终端芯片背后都要经过它的授权。垄断不体现在价格上,而体现在没有人能绕开它做完整设计。几个数字可以说明这种地位:Arm 架构芯片累计出货已超过2500亿颗,全球智能手机SoC中超过99%基于Arm架构;Arm 2024财年营收约 32亿美元,其中大头是按颗计费的版权费——单颗几美分到几美元不等,外加数百万美元级的架构授权门槛。在整个约95亿美元的IP市场中,Arm 一家占据约 四成份额,Synopsys、Cadence 分列其后(行业研究机构口径)。

二是 RISC-V 的回应。RISC-V 的开源指令集给了行业一条替代路径——不是立刻推翻 Arm,而是在边缘计算、定制加速器等场景提供“不被单一vendor锁定”的选项。势头同样有据可查:RISC-V 阵营宣布 2022年累计出货核数突破100亿,研究机构 Semico 预测 2025年RISC-V芯片年出货量将达约627亿颗;阿里平头哥、SiFive 等玩家的高性能核,正在把这条路从微控制器场景推向AI加速器。垄断与开源的拉锯,本质上不是技术之争,而是产业控制权之争。

把94.5亿美元的IP市场和万亿美元级的下游放在一起看,你会得到一个经典的比例:瓶颈环节的规模总是最小的,但议价权总是最大的。这与光刻机之于晶圆制造、EDA之于芯片设计,是同一种结构。

⚠️ 存储暗战:620步配方敲响的警钟

存储行业的门槛,从来不是造出来,而是稳定地、低成本地造出来。

SemiWiki 报道的这则消息,可能是近期存储圈最值得反复咀嚼的一则:韩国法院披露,中国DRAM厂商 CXMT(长鑫存储)被指通过一份成文的路线图,系统性获取了 三星 的DRAM技术。韩媒将该项目称为 “合肥计划”(Project Hefei),据称其中包含一份620步的工艺配方(recipe),而CXMT借此 position 到了 全球DRAM市场约10%的份额,成为主要DRAM厂商之一。

需要客观说明:这是韩方法院披露的指控内容(alleged),属于法律程序中的认定,最终责任与事实认定仍有待司法结论。但无论法律层面如何收场,这起案件揭示的产业逻辑清晰得可怕:

DRAM是标准化程度最高的芯片品类,产品同质化极强,成本曲线就是生死线。在这样的行业里,一份完整的工艺配方意味着什么?意味着可以跳过十年量级的试错积累,直接站到对手爬了十年的成本曲线附近。三星、SK海力士在存储上真正的护城河,从来不是某一颗产品,而是数万个工艺步骤里沉淀的良率know-how。

这起案件的涟漪会远远超出两家公司:

  • 对设备与材料环节:技术扩散的路径一旦被证明存在,全行业的IP保护、设备出口管控、人员流动审查都会收紧,合规成本全面上升;
  • 对地缘格局:存储是中美韩三角中最敏感的品类之一,法院披露的细节会成为各国调整出口管制与产业政策的直接依据;
  • 对后进者:即便绕开了捷径,DRAM的竞争最终仍要回到良率、成本与客户信任的正面战场——10%的份额是起点,能不能守住,拼的还是硬功夫。

无论后续司法结论如何,一个判断已经在业内形成:在高度标准化的存储行业,“工艺配方即资产”的定价逻辑被撕开了口子,所有头部厂商都将被迫重新评估自己的保密体系。

🗺️ 三条线交汇处,是新的竞争坐标系

封装、IP、存储暗战,看似三件不相干的事,其实是同一枚硬币的三个面。

把三组信息放进一张表里,规律会自己浮出来:

战线核心数据竞争焦点主角
先进封装6μm vs 9μm凸点间距,CoWoS产能翻倍扩产异构集成的系统级能力TSMC、英特尔、三星
设计IP94.5亿美元规模,Arm累计出货超2500亿颗控制权:Arm垄断 vs RISC-V开源Arm、RISC-V生态
存储暗战620步配方指控,约10%全球份额工艺know-how与IP保护三星、CXMT

三条线索的共同点在于:竞争的胜负手,正在从“晶体管有多小”转向“系统怎么拼、架构归谁、配方守不守得住”。

pie title 全球DRAM市场份额(综合文中披露口径与公开数据,约值)

"三星" : 40

"SK海力士" : 28

"美光" : 22

"CXMT" : 10

(注:上图为示意值,不同研究机构的统计口径存在差异;其中 CXMT 的约10%份额来自案件披露口径,尚待独立数据验证。)

回到开头的判断。三条线索拼在一起,半导体下半场的图景已经清晰:

  • 封装之争,把价值从晶圆厂单一环节,重新分配到系统集成能力上——6μm 与 9μm 的凸点间距,正在取代“几纳米”成为新的领先刻度;
  • IP之争,把胜负从制造规模,拉回到架构控制权与生态开放度上——95亿美元的市场,锁着万亿美元产业的入口;
  • 存储暗战,则提醒所有人:当纳米竞赛的天花板越来越近,工艺配方、良率know-how和知识产权保护,才是真正难以复制的资产。

摩尔定律仍在,但它的边际收益正在递减;下一轮洗牌的胜负手,藏在封装的凸点间距里、IP的授权条款里、存储的620步配方里。对从业者和投资者而言,重新校准自己的竞争坐标系,已经不是一道选择题,而是时间问题。

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